抑製PCB幹擾,如何在源頭上把EMI減到最小
發布時間:2018-04-16 來源:EDA設計智彙館 責任編輯:lina
【導讀】抑製幹擾源就是盡可能的減小幹擾源的du/dt,di/dt。這是抗幹擾設計中最優 先考慮和最重要的原則,常常會起到事半功倍的效果。減小幹擾源的du/dt主要是通過在幹擾源兩端並聯電容來實現。減小幹擾源對高速電路有著十分重要的作用,下麵我們來看下怎麼在源頭上把EMI減到最小。
一、切斷幹擾傳播
按幹擾的傳播路徑可分為傳導幹擾和輻射幹擾兩類。所謂傳導幹擾是指通過導線傳播到敏感器件的幹擾。高頻幹擾噪聲和 有you用yong信xin號hao的de頻pin帶dai不bu同tong,可ke以yi通tong過guo在zai導dao線xian上shang增zeng加jia濾lv波bo器qi的de方fang法fa切qie斷duan高gao頻pin幹gan擾rao噪zao聲sheng的de傳chuan播bo,有you時shi也ye可ke加jia隔ge離li光guang耦ou來lai解jie決jue。電dian源yuan噪zao聲sheng的de危wei害hai最zui大da,要yao特te別bie 注(zhu)意(yi)處(chu)理(li)。所(suo)謂(wei)輻(fu)射(she)幹(gan)擾(rao)是(shi)指(zhi)通(tong)過(guo)空(kong)間(jian)輻(fu)射(she)傳(chuan)播(bo)到(dao)敏(min)感(gan)器(qi)件(jian)的(de)幹(gan)擾(rao)。一(yi)般(ban)的(de)解(jie)決(jue)方(fang)法(fa)是(shi)增(zeng)加(jia)幹(gan)擾(rao)源(yuan)與(yu)敏(min)感(gan)器(qi)件(jian)的(de)距(ju)離(li),用(yong)地(di)線(xian)把(ba)它(ta)們(men)隔(ge)離(li)和(he)在(zai)敏(min)感(gan)器(qi)件(jian)上(shang)加(jia)蔽(bi)罩(zhao)。
二、屏蔽幹擾
(1)一般來說,在PCB設計中我們通常采用大電流開關線,高頻線兩側,要布滿地線,用來屏蔽電磁幹擾的發射。也用來屏蔽外界雜波對數據線的幹擾
(2)利用屏蔽體隔離可以對元部件、電路或係統等外部的幹擾電磁波和內部電磁波均起著吸收能量(渦流損耗)、反射能量(電磁波在屏蔽體上的界麵反射)和抵消能量(電磁感應在屏蔽層上產生反向電磁場,可抵消部分幹擾電磁波)的作用,所以屏蔽體具有減弱幹擾的功能。 當dang幹gan擾rao電dian磁ci場chang的de頻pin率lv較jiao高gao時shi,利li用yong低di電dian阻zu率lv的de金jin屬shu材cai料liao中zhong產chan生sheng的de渦wo流liu,形xing成cheng對dui外wai來lai電dian磁ci波bo的de抵di消xiao作zuo用yong,從cong而er達da到dao屏ping蔽bi的de效xiao果guo。當dang幹gan擾rao電dian磁ci波bo的de頻pin率lv較jiao低di時shi,要yao采cai用yong高gao導dao磁ci率lv的de材cai料liao,從cong而er使shi磁ci力li線xian限xian製zhi在zai屏ping蔽bi體ti內nei部bu,防fang止zhi擴kuo散san到dao屏ping蔽bi的de空kong間jian去qu。在zai某mou些xie場chang合he下xia,如ru果guo要yao求qiu對dui高gao頻pin和he低di頻pin電dian磁ci場chang都dou具ju有you良liang好hao的de屏ping蔽bi效xiao果guo時shi,往wang往wang采cai用yong不bu同tong的de金jin屬shu材cai料liao組zu成cheng多duo層ceng屏ping蔽bi體ti。
(3)導電漆.EMI導電漆噴塗技術具有高導電性、高電磁屏蔽效率、噴塗操作簡單(同表麵噴漆操作一樣隻須要在塑膠外殼內噴上薄薄一層導電漆)等特點,廣泛應用於通訊製品(移動電話)、電腦(筆記本)、便攜式電子產品、消費電子、網絡硬件(服務器等)、醫療儀器、家用電子產品和航天及國防等電子設備的EMI屏蔽。適用於各種塑膠製品的屏蔽(PC、PC+ABS、ABS等)。噴塗導電漆解決了因做金屬屏蔽罩受空間限製、操作、成本壓力的限製,因其導電漆噴塗操作極其簡單,做到了塑膠金屬化

三、消除幹擾
(1)在電路設計方麵進行優化
增加濾波電路、抗幹擾電路和電源去耦電路等。這些電路原則上要簡單、實用,因為增加複雜的電路,不僅會增加材料成本,而且相應會降低產品的可靠性,同時又可能產生新的幹擾。在有些IC對電源噪音很敏感的情況下,還可以采用4個電容器和一個隔離電感來確保濾除所有的噪音。4個電容大小的選擇要根據幹擾信號的頻率範圍以及其自身的諧波頻率和它的引腳電感來確定。相應的電容值較小
的電容濾除較高頻率的幹擾,而相應的電容值較大的電容適合於濾除較低頻率的噪聲信號。電感L則無法使高頻噪聲從電源耦合到芯片中,通常選擇
10μH左右的色環電感,同時這些電容的排列順序應是:電容越小越盡可能靠近IC引腳。
(2)為了消除PCB內的射頻電(dian)流(liu),磁(ci)通(tong)量(liang)消(xiao)除(chu)或(huo)磁(ci)通(tong)量(liang)最(zui)小(xiao)化(hua)是(shi)個(ge)比(bi)較(jiao)常(chang)用(yong)的(de)概(gai)念(nian)。因(yin)為(wei)磁(ci)通(tong)線(xian)在(zai)傳(chuan)輸(shu)線(xian)中(zhong),以(yi)逆(ni)時(shi)鍾(zhong)方(fang)向(xiang)運(yun)行(xing),如(ru)果(guo)我(wo)們(men)使(shi)射(she)頻(pin)回(hui)傳(chuan)路(lu)徑(jing),平(ping)行(xing)且(qie)鄰(lin)近(jin)於(yu)來(lai)源(yuan)端(duan)的(de)走(zou)線(xian),在(zai)回(hui)傳(chuan)路(lu)徑(jing)(逆時鍾方向的場)上的磁通線,與來源端的路徑(順時鍾方向的場)做zuo比bi較jiao,它ta們men的de方fang向xiang是shi相xiang反fan的de。當dang我wo們men將jiang順shun時shi鍾zhong方fang向xiang的de場chang和he逆ni時shi鍾zhong方fang向xiang的de場chang相xiang互hu組zu合he時shi,可ke以yi產chan生sheng消xiao除chu的de效xiao果guo。如ru果guo在zai來lai源yuan端duan和he回hui傳chuan路lu徑jing之zhi間jian,不bu需xu要yao的de磁ci通tong線xian能neng夠gou被bei消xiao除chu或huo減jian至zhi最zui少shao,則ze輻fu射she或huo傳chuan導dao的de射she頻pin電dian流liu就jiu不bu會hui存cun在zai,除chu非fei是shi在zai走zou線xian的de極ji小xiao邊bian界jie上shang。主zhu要yao的de消xiao除chu磁ci通tong量liang技ji巧qiao有you:
1將組件的塑料封裝內部所產生的磁通線,捕捉到0V的參考係統中,以降低組件的輻射量。
2警慎選擇邏輯組件,盡量減少組件和走線所輻射的射頻頻譜分布量。可以使用訊號緣變化率(edge rate)比較慢的裝置。
3藉由降低射頻驅動電壓,來降低走在線的射頻電流。
4降低接地噪聲電壓,此電壓存在於供電和接地平麵結構中。
5當必須推動最大電容負載,而所有裝置的腳位同時切換時,組件的去耦合(decoupling)電路必須充足。
6必須將頻率和訊號走線做妥善的終結,以避免發生阻尼振蕩(ringing)、電壓過高(overshoot)、電壓過低(undershoot)。
7將頻率走線(clock trace)繞到回傳路徑接地平麵(多層PCB)、接地網格(ground grid)的附近,單側和雙側板可以使用接地走線,或安全走線(guard trace)。
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