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印製板電源完整性及去耦電容優化

發布時間：2017-02-10 責任編輯：wenwei

【導讀】dianyuanwanzhengxinghexinhaowanzhengxing，zaidianlubanshejizhongdezhongyaochengdubuyaneryu，benwenjiandanjieshaoledianyuanwanzhengxingdefangzhen，zaidedaodianyuandezukangquxianhou，ruheshezhiquoudianrong，jiangdiqizaizhenggegongzuopinduanzhongdezukang，congerdadaojiangdiEMI的目的。

首先，我們選擇一塊電路板。版圖是公司的，所以這裏塗黑了，大概知道是塊板子就行了。

印製板電源完整性及去耦電容優化

我們選擇一條5V的USB的走線，電源由右上角饋入，在左下角經過了4顆電容後到達USB接口。

印製板電源完整性及去耦電容優化

按照USB的標準，目前USB3.0的傳輸速度受硬盤影響，最高不超過1Gbps，因此我們關注的頻率在100kHz—2GHz，這裏將其設置為仿真頻段，因為這根Net走線並不長，也沒有蛇形的彎曲部分，所以預測其阻抗變化不是很大，為了給老板省成本，這裏直選了3顆電容。首先得到仿真對象的 spice模型。

印製板電源完整性及去耦電容優化

D9_1和JUSB1_1分別為饋入和饋出，相應的D9_4和JUSB1_5為GND管腳。設置電源內阻為0.1Ω，接下來進行電路連接，3顆電容的位置先空著，查看這條Net的電源阻抗特性。

待仿真結束後，得到這段電源走線的阻抗參數圖，如下：

印製板電源完整性及去耦電容優化

可以看到，由於這根USB走線相對較短，且布線相對比較規範，其阻抗在2GHz範圍內變化並不是很大，最大391Ω。電源信號在該頻段內存在幾處明顯的諧振，為了降低EMI，需要加加去耦電容。目標希望其在整個頻段的阻抗降低到10Ω以下。

印製板電源完整性及去耦電容優化

接下來，將3顆電容連接起來，分別為C1、C2、C3，初始容值均設置為1000pf，並串聯3顆電阻，分別為R1、R2、R3。優化目標：100kHz—2GHz阻抗小於10Ω。

印製板電源完整性及去耦電容優化

優化後得到的結果：

C1 = 3111.65

C2 = 3122.21

C3 = 3111.49

R1 = 7.14841

R2 = 16.6401

R3 = 40.4783

印製板電源完整性及去耦電容優化

上圖為1號端口的Z1_1曲線，綠色曲線為優化後的結果，紅色為初始結果。用了3顆電容感覺還沒達到預定目標，但是從波形的平整度來看，確實要比開始好很多。

印製板電源完整性及去耦電容優化

上圖為2號端口的Z2_2曲線，綠色為優化後的結果，基本上滿足要求了，並且波形的平整度很不錯。

總結，layout板圖在初始的設計過程就應該將電源完整性、信號完整性以及EMC問題考慮進去，這樣會省去後續的大量的測試、整改及修改板圖和工藝的時間及成本。

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