當(dang)前(qian)車(che)載(zai)電(dian)子(zi)係(xi)統(tong)的(de)綜(zong)合(he)化(hua)程(cheng)度(du)隨(sui)著(zhe)計(ji)算(suan)機(ji)和(he)電(dian)子(zi)技(ji)術(shu)的(de)發(fa)展(zhan)不(bu)斷(duan)提(ti)高(gao)，對(dui)視(shi)頻(pin)處(chu)理(li)的(de)綜(zong)合(he)化(hua)要(yao)求(qiu)也(ye)不(bu)斷(duan)提(ti)高(gao)
，如(ru)何(he)對(dui)多(duo)種(zhong)外(wai)視(shi)頻(pin)源(yuan)進(jin)行(xing)處(chu)理(li)與(yu)對(dui)輸(shu)出(chu)通(tong)路(lu)進(jin)行(xing)控(kong)製(zhi)，是(shi)車(che)載(zai)視(shi)頻(pin)處(chu)理(li)中(zhong)麵(mian)臨(lin)的(de)越(yue)來(lai)越(yue)突(tu)出(chu)的(de)問(wen)題(ti)。本(ben)文(wen)討(tao)論(lun)的(de)重(zhong)點(dian)是(shi)以(yi)DSP+FPGA為核心的視頻處理模塊的設計與實現，可以完成多路視頻的切換選擇輸出控製和視頻縮放顯示的功能，同時具備通信控製等功能。

 

 

視頻處理模塊的係統結構如圖1所示
，主要包括以下功能電路：

 

　　（1）DSP電路；

 

　　（2）存儲器電路，包括DDRII及FLASH；

 

　　（3）FPGA功能電路；

 

　　（4）1路高清HDMI接收電路；

 

　　（5）l路標清HDMI發送電路
；

 

　　（6）4路PAL-D接收電路；

 

　　（7）11路PAL-D發送電路；

 

　　（8）CAN通信接口電路
，采用單片機內部集成的CAN通訊控製器實現
；

 

　　（9）電源轉換電路；

 

　　（10）時鍾電路；

 

　　（11）複位及監控電路。

　圖1視頻處理模塊係統結構示意圖

 

視頻處理模塊以DSP+FPGA為核心
，通過CAN總線對其進行功能控製，支持四路PAL視頻輸入及1路高清HDMI視頻輸入，在FPGA內進行視頻縮放處理與切換控製，某些複雜、特殊的視頻處理功能由DSP來實現，最終輸出2路標清視頻
，其中1路標清數字HDMI視頻，1路標清模擬PAL視頻。

 

DSP選用TI公司的DM648處理器，DM648是TI公司為視頻處理應用開發的一款高性能低功耗處理器，它集成了5個視頻端口和圖像協處理器
，主要具有以下特性：

 

　　（1）處理內部主頻1.1GHz，處理速度達到8800MIPS，每個時鍾周期可以執行8個32位C64Xx+指令
；

 

　　（2）具有32kb的LIPProgramRAM和32kb的L1DDataRAM：

 

　　（3）具有支持512kbyte的L2UnifiedMappedRAM；

 

　　（4）支持小端模式；

 

　　（5）具有5個可配置的視頻口

；

 

　　（6）集成外部EMIFS存儲器管理接口，可管理512Mbytes的DDR2SDRAM和128Mbytes的FLASH；

 

本設計中
，DSP通過專用的DDRII接口外接512MB的DDRII存儲器，通過EMIF接口外接32MB的FLASH。DSP的專用視頻口，配置成 2個輸入視頻端口和1個視頻輸出端口，輸入視頻端口接收FPGA送來的視頻數據，輸入視頻端口既可以接收16bit的高清YCrCb數據，也可以接收符合 BT656標準的8bit標清YCrCb數據
；輸出視頻端口輸出符合BT656標準的8bit標清YCrCb數據


，DSP將輸出的視頻數據送給FPGA。

 

 

FPGA用於接收、轉發及處理各種視頻信號，實現視頻縮放
、視頻切換等功能。

 

 

　　（1）外視頻PAL．D數字視頻接收接口

，4路

，符合BT656格式的YCrCb信號，每路視頻接口為8位數據信號，1位時鍾線，時鍾頻率27MHz；

 

　　（2）外視頻高清視頻YCrCb接收接口：1路
，16位數據信號，l位時鍾線，時鍾頻率74．25MHz，4位控製線；

 

　　（3）接收DSP送來的標清數據：1路，符合BT656格式的YCrCb信號，8位數據信號，1位時鍾線
，時鍾頻率27MHz；

 

　　（4）標清數字視頻發送接口：1路，符合BT656格式的YCrCb信號
，8位數據信號，1位時鍾線

，時鍾頻率27MHz
；

 

　　（5）PAL．D數字視頻發送接口：1路，符合BT656格式的YCrCb信號，8位數據信號，1位時鍾線
，時鍾頻率27MHz，2位控製信號；

 

　　（6）送給DSP的高清數字視頻接口：1路，16位數據信號

，l位時鍾線，時鍾頻率74．25MHz，4位控製線
；

 

　　（7）送給DSP的標清數字視頻接口：1路，符合BT656格式的YCrCb信號，8位數據信號
，l位時鍾線
，時鍾頻率27MHz；

 

　　（8）視頻緩存接口：3片SRAM存儲器。

 

視頻處理模塊中，FPGA是其功能控製與處理算法實現的核心器件。隨著FPGA工藝和技術的不斷發展，其邏輯容量
、存儲器資源、DSP乘加器

、軟硬IP核資源都在不斷地擴展和豐富比，使以FPGA為核心完成複雜功能的硬件設計成為可能。FPGA芯片選用Xilinx公司的Spartan6係列低功耗FPGA-XC6SLXl00
，XC6SLXl0芯片豐富的邏輯資源與存儲器資源允許進行複雜的視頻處理邏輯開發口。

 

FPGA邏輯結構功能框圖如圖2所示。

 

高清HDMI的視頻信號時序為符合高清規範的16bit顏色深度的YCrCb信號，經縮放處理模塊縮小後送入SRAM緩存，高清視頻分辨率經縮小後由 1920×1080i變為640×4801
，該視頻數據經時序重構模塊填充成720×576i
，並符合BT656標準。高清原始視頻和縮放後的視頻經2路切換控製模塊之後選擇性地送入DSP的視頻端口。

 

4路PAL視頻解碼後圖像信號時序為符合BT656格式的8bit寬度YCrCb信號
，分辨率為720×576i。4路PAL視頻經過縮放處理後合成l路視頻，分別在屏幕的左上
、左下、右上及右下四個位置顯示4路PAL視頻
，每一路 PAL視頻的分辨率縮小為360×288。處理之後的PAL視頻與原始4路PAL視頻經過5路切換處理之後輸入1路PAL視頻送給DSP。

 

DSP處理後的視頻送給FPGA，在FPGA內部做1分2處理後輸出2路標清視頻。、

圖2FPGA邏輯功能框圖

 

 

本文介紹基於DSP+FPGA的視頻處理模塊的設計與實現
，FPGA負責完成視頻縮放及視頻切換的功能，DSP負責視頻的特殊處理，提供多路視頻任意切換顯示，減少了視頻顯示通道的延遲，較好地滿足了車載視頻綜合顯示的需求。