如何提高電子產品的抗幹擾能力和電磁兼容性：

1、 下麵的一些係統要特別注意抗電磁幹擾：

(1) 微控製器時鍾頻率特別高，總線周期特別快的係統。

(2) 係統含有大功率，大電流驅動電路，如產生火花的繼電器
，大電流開關等。

(3) 含微弱模擬信號電路以及高精度A/D變換電路的係統。

2、 為增加係統的抗電磁幹擾能力采取如下措施：

(1) 選用頻率低的微控製器：

選xuan用yong外wai時shi鍾zhong頻pin率lv低di的de微wei控kong製zhi器qi可ke以yi有you效xiao降jiang低di噪zao聲sheng和he提ti高gao係xi統tong的de抗kang幹gan擾rao能neng力li。同tong樣yang頻pin率lv的de方fang波bo和he正zheng弦xian波bo

，方fang波bo中zhong的de高gao頻pin成cheng份fen比bi正zheng弦xian波bo多duo得de多duo。雖sui然ran方fang波bo的de高gao頻pin成cheng份fen的de波bo的de幅fu度du，比bi基ji波bo小xiao，但dan頻pin率lv越yue高gao越yue容rong易yi發fa射she出chu成cheng為wei噪zao聲sheng源yuan，微wei控kong製zhi器qi產chan生sheng的de最zui有you影ying響xiang的de高gao頻pin噪zao聲sheng大da約yue是shi時shi鍾zhong頻pin率lv的de3倍。

(2) 減小信號傳輸中的畸變微控製器主要采用高速CMOS技術製造。信號輸入端靜態輸入電流在1mA左右，輸入電容10PF左右
，輸入阻抗相當高，高速CMOSdianludeshuchuduandouyouxiangdangdedaizainengli，jixiangdangdadeshuchuzhi
，jiangyigemendeshuchuduantongguoyiduanhenchangxianyindaoshuruzukangxiangdanggaodeshuruduan，fanshewentijiuhenyanzhong，tahuiyinqixinhaojibian，zengjiaxitongzaosheng。dangTpd＞Tr時，就成了一個傳輸線問題，必須考慮信號反射，阻抗匹配等問題。

信xin號hao在zai印yin製zhi板ban上shang的de延yan遲chi時shi間jian與yu引yin線xian的de特te性xing阻zu抗kang有you關guan，即ji與yu印yin製zhi線xian路lu板ban材cai料liao的de介jie電dian常chang數shu有you關guan。可ke以yi粗cu略lve地di認ren為wei，信xin號hao在zai印yin製zhi板ban引yin線xian的de傳chuan輸shu速su度du，約yue為wei光guang速su的de1/3到1/2之間。微控製器構成的係統中常用邏輯電話元件的Tr（標準延遲時間）為3到18ns之間。

在印製線路板上，信號通過一個7W的電阻和一段25cm長的引線，線上延遲時間大致在4~20ns之間。也就是說
，信號在印刷線路上的引線越短越好，最長不宜超過25cm。而且過孔數目也應盡量少，最好不多於2個。

dangxinhaodeshangshengshijiankuaiyuxinhaoyanchishijian，jiuyaoanzhaokuaidianzixuechuli。cishiyaokaolvchuanshuxiandezukangpipei，duiyuyikuaiyinshuaxianlubanshangdejichengkuaizhijiandexinhaochuanshu，yaobimianchuxianTd＞Trd的情況

，印刷線路板越大係統的速度就越不能太快。

用以下結論歸納印刷線路板設計的一個規則：

信號在印刷板上傳輸，其延遲時間不應大於所用器件的標稱延遲時間。

(3) 減小信號線間的交叉幹擾：

A點一個上升時間為Tr的階躍信號通過引線AB傳向B端。信號在AB線上的延遲時間是Td。在D點，由於A點信號的向前傳輸
，到達B點後的信號反射和AB線的延遲
，Td時間以後會感應出一個寬度為Tr的頁脈衝信號。在C點，由於AB上信號的傳輸與反射，會感應出一個寬度為信號在AB線上的延遲時間的兩倍，即2Td的正脈衝信號。這就是信號間的交叉幹擾。幹擾信號的強度與C點信號的di/at有關，與線間距離有關。當兩信號線不是很長時，AB上看到的實際是兩個脈衝的迭加。CMOS工藝製造的微控製由輸入阻抗高，噪聲高
，噪聲容限也很高，數字電路是迭加100~200mv噪聲並不影響其工作。

若圖中AB線(xian)是(shi)一(yi)模(mo)擬(ni)信(xin)號(hao)，這(zhe)種(zhong)幹(gan)擾(rao)就(jiu)變(bian)為(wei)不(bu)能(neng)容(rong)忍(ren)。如(ru)印(yin)刷(shua)線(xian)路(lu)板(ban)為(wei)四(si)層(ceng)板(ban)
，其(qi)中(zhong)有(you)一(yi)層(ceng)是(shi)大(da)麵(mian)積(ji)的(de)地(di)，或(huo)雙(shuang)麵(mian)板(ban)，信(xin)號(hao)線(xian)的(de)反(fan)麵(mian)是(shi)大(da)麵(mian)積(ji)的(de)地(di)時(shi)
，這(zhe)種(zhong)信(xin)號(hao)間(jian)的(de)交(jiao)叉(cha)幹(gan)擾(rao)就(jiu)會(hui)變(bian)小(xiao)。原(yuan)因(yin)是(shi)
，大(da)麵(mian)積(ji)的(de)地(di)減(jian)小(xiao)了(le)信(xin)號(hao)線(xian)的(de)特(te)性(xing)阻(zu)抗(kang)，信(xin)號(hao)在(zai)D端的反射大為減小。特性阻抗與信號線到地間的介質的介電常數的平方成反比，與介質厚度的自然對數成正比。若AB線為一模擬信號
，要避免數字電路信號線CD對AB的幹擾
，AB線下方要有大麵積的地，AB線到CD線的距離要大於AB線與地距離的2~3倍。可用局部屏蔽地，在有引結的一麵引線左右兩側布以地線。

(4) 減小來自電源的噪聲

dianyuanzaixiangxitongtigongnengyuandetongshi，yejiangqizaoshengjiadaosuogongdiandedianyuanshang。dianluzhongweikongzhiqidefuweixian，zhongduanxian，yijiqitayixiekongzhixianzuirongyishouwaijiezaoshengdeganrao。dianwangshangdeqiangganraotongguodianyuanjinrudianlu，jishidianchigongdiandexitong，dianchibenshenyeyougaopinzaosheng。monidianluzhongdemonixinhaogengjingshoubuzhulaizidianyuandeganrao。

(5) 注意印刷線板與元器件的高頻特性在高頻情況下，印刷線路板上的引線，過孔，電阻
、電容、jiechajiandefenbudianganyudianrongdengbukehulve。dianrongdefenbudianganbukehulve，diangandefenbudianrongbukehulve。dianzuchanshengduigaopinxinhaodefanshe，yinxiandefenbudianronghuiqizuoyong，dangchangdudayuzaoshengpinlvxiangyingbochangde1/20時，就產生天線效應，噪聲通過引線向外發射。印刷線路板的過孔大約引起0.6pf的電容。

一個集成電路本身的封裝材料引入2~6pf電容。

一個線路板上的接插件
，有520nH的分布電感。一個雙列直扡的24引腳集成電路扡座

，引入4~18nH的分布電感。

這些小的分布參數對於這行較低頻率下的微控製器係統中是可以忽略不計的；而對於高速係統必須予以特別注意。

(6) 元件布置要合理分區

元yuan件jian在zai印yin刷shua線xian路lu板ban上shang排pai列lie的de位wei置zhi要yao充chong分fen考kao慮lv抗kang電dian磁ci幹gan擾rao問wen題ti
，原yuan則ze之zhi一yi是shi各ge部bu件jian之zhi間jian的de引yin線xian要yao盡jin量liang短duan。在zai布bu局ju上shang，要yao把ba模mo擬ni信xin號hao部bu分fen
，高gao速su數shu字zi電dian路lu部bu分fen
，噪zao聲sheng源yuan部bu分fen（如繼電器，大電流開關等）這三部分合理地分開，使相互間的信號耦合為最小。

(7) 處理好接地線

印刷電路板上，電源線和地線最重要。克服電磁幹擾
，最主要的手段就是接地。

duiyushuangmianban，dixianbuzhitebiejiangjiu
，tongguocaiyongdandianjiedifa，dianyuanhedishicongdianyuandeliangduanjiedaoyinshuaxianlubanshanglaide，dianyuanyigejiedian
，diyigejiedian。yinshuaxianlubanshang

，yaoyouduogefanhuidixian
，zhexiedouhuijudaohuidianyuandenagejiedianshang，jiushisuoweidandianjiedi。suoweimonidi、數字地、dagonglvqijiandikaifen，shizhibuxianfenkai，erzuihoudouhuijidaozhegejiedidianshanglai。yuyinshuaxianlubanyiwaidexinhaoxianglianshi，tongchangcaiyongpingbidianlan。duiyugaopinheshuzixinhao

，pingbidianlanliangduandoujiedi。dipinmonixinhaoyongdepingbidianlan，yiduanjiediweihao。

對噪聲和幹擾非常敏感的電路或高頻噪聲特別嚴重的電路應該用金屬罩屏蔽起來。

(8) 用好去耦電容。

好的高頻去耦電容可以去除高到1GHZdegaopinchengfen。taocipiandianronghuoduocengtaocidianrongdegaopintexingjiaohao。shejiyinshuaxianlubanshi，meigejichengdianludedianyuan，dizhijiandouyaojiayigequoudianrong。quoudianrongyoulianggezuoyong：一方麵是本集成電路的蓄能電容，提供和吸收該集成電路開門關門瞬間的充放電能
；另一方麵旁路掉該器件的高頻噪聲。數字電路中典型的去耦電容為0.1uf的去耦電容有5nH分布電感，它的並行共振頻率大約在7MHz左右
，也就是說對於10MHz以下的噪聲有較好的去耦作用，對40MHz以上的噪聲幾乎不起作用。

1uf
，10uf電容，並行共振頻率在20MHz以上，去除高頻率噪聲的效果要好一些。在電源進入印刷板的地方和一個1uf或10uf的去高頻電容往往是有利的
，即使是用電池供電的係統也需要這種電容。

每10片左右的集成電路要加一片充放電電容，或稱為蓄放電容
，電容大小可選10uf。最zui好hao不bu用yong電dian解jie電dian容rong，電dian解jie電dian容rong是shi兩liang層ceng溥pu膜mo卷juan起qi來lai的de，這zhe種zhong卷juan起qi來lai的de結jie構gou在zai高gao頻pin時shi表biao現xian為wei電dian感gan
，最zui好hao使shi用yong膽dan電dian容rong或huo聚ju碳tan酸suan醞yun電dian容rong。去qu耦ou電dian容rong值zhi的de選xuan取qu並bing不bu嚴yan格ge
，可ke按anC=1/f計算
；即10MHz取0.1uf，對微控製器構成的係統
，取0.1~0.01uf之間都可以。

3、 降低噪聲與電磁幹擾的一些經驗。

(1) 能用低速芯片就不用高速的，高速芯片用在關鍵地方。

(2) 可用串一個電阻的辦法，降低控製電路上下沿跳變速率。

(3) 盡量為繼電器等提供某種形式的阻尼。

(4) 使用滿足係統要求的最低頻率時鍾。

(5) 時鍾產生器盡量靠近到用該時鍾的器件。石英晶體振蕩器外殼要接地。

(6) 用地線將時鍾區圈起來
，時鍾線盡量短。

(7) I/O驅動電路盡量靠近印刷板邊，讓其盡快離開印刷板。對進入印製板的信號要加濾波，從高噪聲區來的信號也要加濾波，同時
串終端電阻的辦法，減小信號反射。

(8) MCD無用端要接高，或接地
，或定義成輸出端，集成電路上該接電源地的端都要接，不要懸空。

(9) 閑置不用的門電路輸入端不要懸空，閑置不用的運放正輸入端接地

，負輸入端接輸出端。

(10) 印製板盡量使用45折線而不用90折線布線以減小高頻信號對外的發射與耦合。

(11) 印製板按頻率和電流開關特性分區，噪聲元件與非噪聲元件要距離再遠一些。

(12) 單麵板和雙麵板用單點接電源和單點接地、電源線、地線盡量粗
，經濟是能承受的話用多層板以減小電源

，地的容生電感。

(13) 時鍾、總線、片選信號要遠離I/O線和接插件。

(14) 模擬電壓輸入線、參考電壓端要盡量遠離數字電路信號線，特別是時鍾。

(15) 對A/D類器件


，數字部分與模擬部分寧可統一下也不要交叉。

(16) 時鍾線垂直於I/O線比平行I/O線幹擾小，時鍾元件引腳遠離I/O電纜。

(17) 元件引腳盡量短，去耦電容引腳盡量短。

(18) 關鍵的線要盡量粗，並在兩邊加上保護地。高速線要短要直。

(19) 對噪聲敏感的線不要與大電流

，高速開關線平行。

(20) 石英晶體下麵以及對噪聲敏感的器件下麵不要走線。

(21) 弱信號電路
，低頻電路周圍不要形成電流環路。

(22) 任何信號都不要形成環路
，如不可避免，讓環路區盡量小。

(23) 每個集成電路一個去耦電容。每個電解電容邊上都要加一個小的高頻旁路電容。

(24) 用大容量的鉭電容或聚酷電容而不用電解電容作電路充放電儲能電容。使用管狀電容時，外殼要接地。



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