采用傳統方法解釋CTSD技術概念時，都是先理解離散時間∑-Δ (DTSD)調製器環路的基本原理，然後用等效的連續時間元件來替換離散時間環路元件。雖然通過這種方法可以深入了解∑-Δ功能，但我們的目標是更直觀地了解精密CTSD ADC內在優勢的背後原因。首先，我們將概述一種逐步構建CTSD調製器環路的方法，首先采用常見的閉環反相放大器配置，然後與ADC和DAC組合在一起。最後，我們將評估所構建電路的基本∑-Δ功能。

 

第1步：回顧閉環反相放大器配置

 

CTSD ADC的(de)一(yi)個(ge)關(guan)鍵(jian)優(you)勢(shi)是(shi)它(ta)提(ti)供(gong)一(yi)個(ge)易(yi)於(yu)驅(qu)動(dong)的(de)連(lian)續(xu)電(dian)阻(zu)輸(shu)入(ru)，而(er)非(fei)傳(chuan)統(tong)的(de)前(qian)置(zhi)開(kai)關(guan)電(dian)容(rong)采(cai)樣(yang)器(qi)。反(fan)相(xiang)放(fang)大(da)器(qi)電(dian)路(lu)具(ju)有(you)類(lei)似(si)的(de)輸(shu)入(ru)阻(zu)抗(kang)概(gai)念(nian)

，我(wo)們(men)將(jiang)其(qi)用(yong)作(zuo)構(gou)建(jian)CTSD調製器環路的起始模塊。

 

閉環運算放大器配置一直是以高保真度複製模擬輸入的首選方法，圖1所示為其中一種常見的運算放大器配置
，稱為反相放大器配置。1衡量保真度的一個指標是輸出與輸入增益的比值
，采用∑-Δ術語表示，也稱為信號傳遞函數(STF)。確定影響STF的參數需要進行電路分析。

 

圖1.采用反相放大器配置的閉環運算放大器。

 

為了鞏固我們的數學知識，我們來回顧一下著名V_OUT ⁄V_IN的由來。首先，我們假設運算放大器A的開環增益無窮大。根據這一假設
，運算放大器的負輸入V_n將處於地電位。在這裏應用基爾霍夫定律

 

 

將其映射到V_OUT和V_IN，我們得到增益或STF為

 

 

接下來，我們放棄不切實際的無限增益假設
，在運算放大器的有限增益A下重新推導STF，則STF如下式所示

 

 

在這裏
，教科書通常會描述每個參數R_IN、R_f和A的靈敏度。在本示例中，我們繼續構建CTSD環路。

 

第2步：將離散部件引入放大器

 

我們的ADC信號鏈需要數字版本的V_IN。下一步
，我們要在此電路中引入數字部件。我們沒有按傳統方式直接在輸入信號端放置一個采樣ADC，而是嚐試其他方法，在放大器輸出之後放置一個典型ADC器件來獲取數字信號數據。但是
，ADC的輸出不能直接用作反饋，因為它必須是模擬電壓。因此，我們需要在ADC之後放置一個電壓數模轉換器(DAC)，如圖2所示。

 

圖2.在反相放大器配置中引入ADC和DAC。

 

采用ADC和DAC後，V_OUT仍能表示V_IN，但由於增加了數字部件，因此存在量化誤差。所以
，從V_IN到V_OUT的信號流沒有變化。這裏要注意的一點是
，為了使環路功能相對於0 V保持對稱，並簡化數學推導，我們這樣選擇ADC和DAC的基準電壓
，如下所示

 

 

第3步：引入模擬累加器 — 積分器

 

圖2中的閉環配置是否穩定
？ADC和DAC均為在采樣時鍾MCLK下工作的離散元件。設計無延遲ADC或DAC一(yi)直(zhi)是(shi)轉(zhuan)換(huan)器(qi)專(zhuan)家(jia)無(wu)法(fa)實(shi)現(xian)的(de)夢(meng)想(xiang)。由(you)於(yu)這(zhe)些(xie)環(huan)路(lu)元(yuan)件(jian)采(cai)用(yong)時(shi)序(xu)控(kong)製(zhi)，通(tong)常(chang)在(zai)一(yi)個(ge)時(shi)鍾(zhong)沿(yan)進(jin)行(xing)輸(shu)入(ru)采(cai)樣(yang)，在(zai)另(ling)一(yi)個(ge)時(shi)鍾(zhong)沿(yan)進(jin)行(xing)處(chu)理(li)。因(yin)此(ci)
，ADC和DAC組合輸出V_OUT（即圖2中的反饋）需要延遲1個時鍾周期後才可用。

 

這種反饋延遲對穩定性有影響嗎？我們來看看V_IN是如何傳輸的。為簡化起見，我們假設V_IN = 1，R_IN = 1，R_f = 1
，運算放大器A的增益為100。在第一個時鍾周期，輸入電壓為1
，DAC輸出反饋VOUT或V_OUTDAC為0，並且在下一個時鍾沿前不可用。當我們跟蹤放大器和ADC的輸入和輸出反饋之間的誤差時，可以看到輸出一直呈指數增長

，這在技術上稱為失控問題。

 

表1.時鍾沿采樣

 

這是因為ADC輸入對放大器獲得的瞬時誤差產生的影響；也就是說，甚至在獲得反饋之前
，就能確定ADC會產生這種影響
，而這是我們不希望的。如果ADC影響累積的平均誤差數據
，使得由於1個時鍾周期延遲反饋導致的誤差達到平均值，係統的輸出將受限。

 

積分器是平均累加器的等效模擬器件。環路增益仍然很高，但僅在低頻下很高


，或者說在目標頻率帶寬下很高。這確保ADC不會出現任何可能導致失控情況的瞬時誤差。因此，現在將環路中的放大器改為積分器後接ADC和DAC，如圖3a所示。

 

圖3.(a) 將積分器引入環路。(b) 重新布局環路
，重點將DOUTADC作為輸出。

 

第4步：簡化反饋電阻

 

這裏的目標元件是D_OUTADC
，我們來重新布局環路元件
，重點是將D_OUTADC作為係統的輸出
，如圖3b所示。接下來
，我們來考慮DAC和Rf路徑的簡化。為此，我們先深入了解一下DAC。DAC的作用是將D_IN數shu字zi信xin號hao轉zhuan換huan為wei與yu基ji準zhun電dian壓ya成cheng比bi例li的de等deng效xiao模mo擬ni電dian流liu或huo電dian壓ya。為wei了le進jin一yi步bu擴kuo大da基ji準zhun電dian壓ya源yuan連lian續xu性xing的de優you勢shi
，我wo們men考kao慮lv采cai用yong一yi個ge基ji於yu梯ti形xing電dian阻zu的de通tong用yongDAC架構，該電阻對於基準電壓源沒有開關負載。我們來看測溫電阻DAC
，2根據等式5，它將D_IN轉換為DAC電流。

 

 

其中 V_REF = V_REFP – V_REFM，即DAC的總基準電壓。

 

●    D_IN = 測溫代碼中的數字輸入

●    R_f = 反饋電阻；拆分為每個單位元件

●    N = 位數

 

 

圖4.通用測溫電阻DAC。

 

為了獲得電壓輸出，使用跨阻配置的運算放大器進行I至V轉換，3 如圖4所示。因此，

 

 

回到圖3b的離散環路
，此V_OUTDAC再次通過反相放大器的反饋電阻被轉換回電流I_fb，即信號流為I_DAC → V_{OUTDA C} → I_fb。通過數學式表示為：

 

 

從上麵的信號流和公式可以看出，將V_OUTDAC轉換為I_fb是一個冗餘步驟
，可以繞過。刪除冗餘元件
，並且為了簡單起見
，將(V_REFP – V_REFM)表示為V_REF，我們來重新繪製環路，如圖5所示。

 

圖5.刪除冗餘I至V轉換部分和反饋電阻。

 

瞧！我們構建了一個一階Σ-Δ環路！將所有已知元件即反相放大器、ADC和DAC接在一起。

 

第5步：了解過采樣

 

至此我們掌握了CTSD環路的構建，但尚未認識到這個特殊環路的獨特之處。首先來了解過采樣。ADC數據僅在有足夠的采樣和數字化數據點來提取或解讀模擬信號信息時才有用。奈奎斯特準則建議
，為了忠實地重構輸入信號，ADC的de采cai樣yang頻pin率lv至zhi少shao應ying該gai是shi信xin號hao頻pin率lv的de兩liang倍bei。如ru果guo我wo們men在zai這zhe個ge最zui低di要yao求qiu基ji礎chu上shang繼ji續xu增zeng加jia更geng多duo的de數shu據ju點dian
，將jiang會hui進jin一yi步bu減jian少shao解jie讀du誤wu差cha。遵zun循xun這zhe一yi思si路lu，在zai∑-Δ中選擇的采樣頻率要比建議的奈奎斯特頻率高得多
，這稱為過采樣。過采樣4將總噪聲分散到更高的頻率範圍，有助於減少目標頻帶中的量化噪聲，如圖6所示。

 

圖6.奈奎斯特采樣和過采樣之間的噪聲譜密度比較。

 

第6步：了解噪聲整形

 

當∑-Δ專家使用噪聲傳遞函數(NTF)或噪聲整形等術語時
，信號鏈設計人員不應該感到迷茫，4我們的下一步將幫助他們直觀地了解∑-Δ轉換器特有的這些術語。我們來回顧一下簡單的反相放大器配置以及放大器輸出端產生的誤差Q_e，如圖7所示。

 

圖7.反相放大器配置中產生誤差。

 

此誤差在輸出端的貢獻因素可量化為

 

 

從數學公式可以看出，誤差Q_e由放大器的開環增益衰減
，這再次表明了閉環的優勢。

 

這種對閉環優勢的理解可以延伸到CTSD環路中ADC的量化誤差Q_e，此誤差是由於積分器輸出端連續信號的數字化引起的，如圖8所示。

 

圖8.∑-Δ環路中產生量化誤差Qe。

 

我們現在可以直觀地得出結論，此Q_e可通過積分器衰減。積分器TF為|H_INTEG (f)|= 1/|s × RC| = 1/2πfRC，其相應的頻域表示如圖9所示。其曲線等同於在低頻下具有高增益的低通濾波器曲線
，增益隨頻率的增加呈線性減小。相應地，Q_e的衰減變化與高通濾波器的表現類似。

 

圖9.積分器傳遞函數。

 

此衰減因數的數學表示是噪聲傳遞函數。讓我們暫時忽略ADC中的采樣器和DAC中的開關。NTF即V_OUTADC / Q_e可通過與反相放大器配置一樣的方式來評估，其在頻域中的變化曲線與高通濾波器曲線類似，如圖10所示。

 

 

在目標頻帶中，量化噪聲被完全衰減並推至"與我們無關"的高頻。這就是所謂的噪聲整形。

 

圖10.沒有采樣器時的噪聲傳遞函數——具有高通濾波器曲線。

 

由於環路中有采樣器
，量化噪聲整形類比保持不變。不同的是，NTF頻率響應將在每個f_S倍數處複製圖像，如圖10所示，從而在采樣頻率的每個整數倍處產生陷波。

 

圖11.CTSD ADC的噪聲傳遞函數。

 

∑-Δ架構的獨特之處在於，它將一個積分器和一個DAC環路放置在一個原始ADC（例如，4位ADC）周圍

，通過過采樣和噪聲整形大幅減少目標頻率帶寬中的量化噪聲，使這個原始ADC變成一個16位或24位精密ADC。

 

這些一階CTSD ADC的基本原理現在可以擴展到任意階的調製器環路。采樣頻率

、原始ADC規格和環路階數是受ADC性能要求驅動的主要設計決策因素。

 

第7步：利用數字濾波器完成CTSD調製器

 

一般來講，在ADC信號鏈中，數字化數據由外部數字控製器進行後處理
，以提取任何信號信息。我們現在知道

，在∑-Δjiagouzhong，jiangduixinhaojinxingguocaiyang。ruguojiangciguocaiyangshuzishujuzhijietigonggeiwaibukongzhiqi，jiuxuyaochulidaliangrongyushuju。zhehuidaozhishuzikongzhiqishejizhongdegonglvhedianlubankongjianchengbenkaixiaoguoda。yinci，zaishujutigonggeishuzikongzhiqizhiqian，zaibuyingxiangxingnengdeqingkuangxia，yingyouxiaodijiangdishujucaiyang。ciguochengchengweichouqu，youshuzichouqulvboqiwancheng。tu11所示為具有片內數字抽取濾波器的典型CTSD調製器。

 

圖12.(a) 從模擬輸入到數字輸出的CTSD ADC調製器環路的方框圖。(b) 調製器輸出端和數字濾波器輸出端的輸入信號的頻譜表示。

 

圖12b所(suo)示(shi)為(wei)帶(dai)內(nei)模(mo)擬(ni)輸(shu)入(ru)信(xin)號(hao)的(de)頻(pin)率(lv)響(xiang)應(ying)。在(zai)調(tiao)製(zhi)器(qi)的(de)輸(shu)出(chu)端(duan)，我(wo)們(men)看(kan)到(dao)對(dui)量(liang)化(hua)噪(zao)聲(sheng)進(jin)行(xing)噪(zao)聲(sheng)整(zheng)形(xing)後(hou)，目(mu)標(biao)頻(pin)帶(dai)中(zhong)的(de)量(liang)化(hua)噪(zao)聲(sheng)大(da)幅(fu)降(jiang)低(di)。數(shu)字(zi)濾(lv)波(bo)器(qi)有(you)助(zhu)於(yu)衰(shuai)減(jian)超(chao)出(chu)此(ci)目(mu)標(biao)頻(pin)率(lv)帶(dai)寬(kuan)的(de)整(zheng)形(xing)後(hou)噪(zao)聲(sheng)，這(zhe)樣(yang)最(zui)終(zhong)的(de)數(shu)字(zi)輸(shu)出(chu)DOUT將處於奈奎斯特采樣速率。

 

第8步：了解CTSD ADC的時鍾靈敏度

 

現在
，我們知道CTSD ADC如何保持輸入信號的連續完整性，這大大簡化了信號鏈的設計。此架構也有一些限製，主要是處理采樣時鍾MCLK。CTSD調製器環路的工作原理是累積I_IN和I_DAC之間的誤差電流。此積分值中的任何誤差都會導致環路中的ADC對此誤差進行采樣，並在輸出中反映出來。對於我們的一階積分器環路

，在恒定I_IN和I_DAC的T_s采樣時間段的積分值表示為

 

 

對於0輸入，會影響此積分誤差的參數包括

 

●    MCLK頻率：如等式10所示，如果MCLK頻率縮放，控製積分斜率的RC係數也需要重新調整以得到相同的積分值。這意味著CTSD調製器針對固定的MCLK時鍾頻率進行調諧，無法支持變化的MCLK。

●    MCLK抖動：DAC代碼以及I_DAC會改變每個時鍾時間段T_s。如果I_DAC時間段隨機改變


，平均積分值就會不斷變化，如圖13所示。因此，采樣時鍾時間段中以抖動形式出現的任何誤差都會影響調製器環路的性能。

 

圖13.CTSD調製器的時鍾靈敏度。

 

出於上述原因
，CTSD ADC對MCLK的頻率和抖動敏感。5但是，ADI已經找到了解決這些誤差問題的方法。例如，生成精確的低抖動MCLK並在係統中傳送到ADC的挑戰，可以通過在ADC附近使用一個低成本的本地晶體振蕩器來解決。固定采樣頻率周圍的誤差問題已通過使用創新的異步采樣速率轉換(ASRC)解決，該轉換無需考慮固定采樣MCLK，可以為數字控製器提供獨立可變的數字輸出數據速率。本係列後續文章將詳細介紹更多相關信息。

 

第9步：瞧！一切準備就緒，可以向夥伴們解釋CTSD概念了！

 

第1部分 強調了CTSD ADC的某些信號鏈優勢，而第2部分重點介紹從第1步到第6步使用閉環運算放大器配置概念構建調製器環路的見解。圖11a也有助於我們看清這些優勢。

 

CTSD ADC的輸入阻抗等同於反相放大器的輸入阻抗

，它是電阻性的，且易於驅動。通過使用創新技術，使得調製器環路的DAC所使用的基準電壓源也成為電阻性。ADC的de采cai樣yang器qi位wei於yu積ji分fen器qi之zhi後hou，並bing非fei直zhi接jie放fang在zai輸shu入ru端duan，從cong而er可ke實shi現xian對dui目mu標biao頻pin帶dai之zhi外wai幹gan擾rao源yuan的de固gu有you混hun疊die抑yi製zhi。在zai本ben係xi列lie接jie下xia來lai的de幾ji篇pian文wen章zhang中zhong，我wo們men將jiang深shen入ru探tan討tao這zhe些xie優you勢shi及ji其qi對dui信xin號hao鏈lian的de影ying響xiang。在zai下xia一yi篇pian文wen章zhang中zhong，我wo們men將jiang首shou先xian介jie紹shao最zui獨du特te的de優you勢shi：固有混疊抑製。敬請關注第3部分
，了解固有混疊抑製及其使用一組新的測量和性能參數實現量化的詳細信息，這些參數首次通過基於CTSD架構的AD4134引入。

 

參考電路

 

1 Hank Zumbahlen。 “微型教程MT-213：反相放大器.”ADI公司，2013年2月。

 

2 Walt Kester。 “MT-014教程：基本DAC架構I：DAC串和溫度計（完全解碼）DAC.” ADI公司，2009年。

 

3 Luis Orozco。 “可編程增益跨阻放大器使光譜係統的動態範圍達到最大.” 《模擬對話》，第47卷第2期，2013年5月。

 

4 Walt Kester。 “MT-022教程：ADC架構III：Σ-Δ型ADC基礎.” ADI公司，2009年。

 

5 Pawel Czapor。“Σ-Δ ADC時鍾——不隻是抖動.” 模擬對話，第53卷第3期，2019年4月。

 

Pavan、Shanthi、Richard Schreier和Gabor C. Temes。 了解∑-∆數據轉換器，第2版，2017年1月。

 

致謝

 

作者在此向Praveen Varma和Roberto Maurino致謝，感謝他們在以簡化方式解釋CTSD ADC技術方麵提供的有益見解。

 

 

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